« Pico SE4 2023/2024 » : différence entre les versions

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= Objectif =
= Objectif =


Pour l'année académique 2023/2024 nous vous demandons de construire un pico-ordinateur comprenant les éléments suivants :
Voir le sujet dans le menu englobant. Vous aurez, comme d'habitude, la lourde tâche de tester ce module de travaux pratiques.
* un processeur de type microcontrôleur ;
* un clavier ;
* un dispositif d'affichage ;
* un système d'exploitation stocké dans la mémoire flash du microcontrôleur ;
* une mémoire de masse allant au delà de la mémoire flash sus-citée ;
* un dispositif de communication avec l'extérieur.


Pour faire en sorte que tous les éléments puissent communiquer entre eux nous vous demandons d'utiliser le bus SPI.
= Réalisations des élèves =


= Organisation du travail =
{| class="wikitable"
 
! Numéro du binôme !! Numéro du groupe !! Elèves !! Page
Vous aurez, comme d'habitude, la lourde tâche de tester ce module de travaux pratiques. Ce sera d'autant moins facile
|-
que nous vous demandons de vous coordonner pour réaliser le pico-ordinateur : un seul exemplaire fonctionnel est attendu.
| Binôme 1
Vous allez donc devoir vous organiser pour que chaque binôme réalise une partie de l'ensemble.
| Groupe 1
 
| Taha NEHARI & Martin CHAUVELIERE
= Tâches à réaliser =
| [[SE4Binome2023-1|Binôme 1 2023/2024]]
 
|-
Les tâches à réaliser sont de plusieurs types :
| Binôme 2
* fabrication de cartes, que ce soit des cartes mères ou des cartes filles ;
| Groupe 1
* programmation de cartes FPGA en VHDL pour réaliser des cartes filles très spécifiques ;
| Simon CRUCHET & Amaury BECQUET
* programmation du système d'exploitation.
| [[SE4Binome2023-2|Binôme 2 2023/2024]]
 
|-
== Cartes électroniques ==
| Binôme 3
 
| Groupe 1
Les pistes pour les cartes classiques :
| Louis DERYCKERE & Romain DUHR
* une carte CPU ATMega328p avec une flash SPI NAND ;
| [[SE4Binome2023-3|Binôme 3 2023/2024]]
* une carte fille SPI avec un ATMega328p et une matrice de touches (clavier) ;
|-
* une carte fille SPI avec un AT90USB647 pour connexion à un clavier USB ou une clef USB ;
| Binôme 4
* une carte fille SPI avec un ATMega16u2 pour une connexion série USB ;
| Groupe 1
* une carte fille SPI avec un ATMega16u2 pour une connexion réseau (EP bulk ou RNDIS) ;
| Thomas NAVE & Thibault DUYCK
* une carte fille SPI avec un ATMega328p et un ENC28J60 pour une connexion Ethernet.
| [[SE4Binome2023-4|Binôme 4 2023/2024]]
 
|-
== Cartes FPGA ==
| Binôme 5
 
| Groupe 2
Les pistes pour VHDL FPGA :
| Stéphane KADER ISSACK & Marion NORMAND
1) VGA mais déjà vu en TP donc peut être trop simple ?
| [[SE4Binome2023-5|Binôme 5 2023/2024]]
2) interface SD non SPI (j'ai proposé interface paralèlle avec le uC mais j'ai pas compris si c'était intéressant ou pas)
|-
3) des portions d'Ethernet (e.g. calcul de checksum, transceiver manchester, interface sériel avec le uC ?)
| Binôme 6
 
| Groupe 2
== Programmation système ==
| Dylan Ling
 
| [[SE4Binome2023-6|Binôme 6 2023/2024]]
Le système d'exploitation du pico-ordinateur doit avoir les fonctionnalités d'un DOS (Disk Operating System), à savoir :
|-
* lecture des commandes tapées par l'utilisateur ;
| Binôme 7
* téléchargement d'exécutables ou de sources via le dispositif de communication extérieur  ;
| Groupe 2
* sauvegarde et chargement d'exécutables ou de sources via la mémoire de masse ;
| Louis WIJSMAN & Adrien PALIFERRO
 
| [[SE4Binome2023-7|Binôme 7 2023/2024]]
* affichage de chaînes de caractères ;
|-
* ordonnancement
| Binôme 8
* interpréteur micro-python
| Groupe 2
 
| Némo CAZIN & Antoine CEGARRA
 
| [[SE4Binome2023-8|Binôme 8 2023/2024]]
= Détails (brouillon) =
|-
 
| Binôme 9
  La structure de la plateforme de projet :
| Groupe 3
 
| Younes BENMBAREK & Youness EL QASTALANI
* Processeur du pico :
| [[SE4Binome2023-9|Binôme 9 2023/2024]]
  1) ATMega328p (utilisation possible d'Arduino nano ou mini)
|-
  2) ATMega{16,32}u{2,4} pour avoir directement une connexion USB
| Binôme 10
  3) ATXMega (kit de dév disponibles) pour avoir plusieurs UART, faire du DMA, non testé
| Groupe 3
  4) ARM cortex-M0 (ce serait probablement le mieux mais ça me paraît joueur)
| Heriniaina ANDRIANIRINTSOA & Chaymae RHANIM
 
| [[SE4Binome2023-10|Binôme 10 2023/2024]]
* Clavier :
|-
  1) Port série
| Binôme 11
  2) Clavier maison avec matrice de touches
| Groupe 3
  3) Clavier USB avec un AT90USB647 LUFA/Host
| Ayoub CHAOUNI & Bilal EL HASNAOUI
 
| [[SE4Binome2023-11|Binôme 11 2023/2024]]
* Ecran :
|-
  1) Port série
|}
  2) Ecran LCD
  *) FPGA VGA (à faire dans tous les cas)
 
* BIOS en mémoire Flash du processeur
 
* Mémoire de masse
  1) EEPROM du SoC
  2) Flash SPI
  3) Clef USB avec un AT90USB647 LUFA/Host
  4) FPGA mémoire M.2 :D
 
* Communication extérieure
  1) Port série
  2) Connexion USB "vendeur spécifique"
  3) Puce Ethernet 10Mb/s ENC28J60
  4) Connexion USB LUFA/RNDIS
5) Ethernet natif sur des ARM
 
  Des architectures possibles :
 
  * Compacte :
    - un ATMega*u*,
    - son port série (TX) pour la communication vers FPGA/VGA,
    - son port série (RX) pour le clavier (terminal série),
    - son port SPI pour la mémoire de masse,
    - son module USB pour la connexion "vendeur spécifique".
 
  * Distribuée bus série partagé :
    - un ATMega328p,
    - un port série partagé (TX pour sélectionner un gestionnaire) :
      = 'V' pour vidéo, envoi vers le gestionnaire vidéo FPGA/VGA,
      = 'S' communication avec le gestionnaire série (un ATMega*u* LUFA/CDC),
      = 'C' communication avec le gestionnaire clavier (un AT90USB647 LUFA/Host/Clavier),
      = 'M' communication avec le gestionnaire mémoire de masse (un ATMega* avec une flash SPI),
      = 'R' communication avec le gestionnaire réseau (un ATMega*u* LUFA/RNDIS).
 
  * Distribuée bus SPI :
    - un ATMega328p,
    - son port série pour le gestionnaire vidéo FPGA/VGA,
    - son bus SPI :
        = communication avec le gestionnaire série (un ATMega*u* LUFA/CDC),
        = communication avec le gestionnaire clavier (un AT90USB647 LUFA/Host/Clavier),
        = communication avec le gestionnaire mémoire de masse (un ATMega* avec une flash SPI),
        = communication avec le gestionnaire réseau (un ATMega*u* LUFA/RNDIS).
 
  * Distribuée avec plusieurs UART :
    - un ATXMega,
    - port série (TX) vers le gestionnaire vidéo FPGA/VGA,
    - port série (RX) pour les entrées clavier série,
    - port série avec le gestionnaire clavier (un AT90USB647 LUFA/Host/Clavier),
    - port série avec le gestionnaire mémoire de masse (un ATMega* avec une flash SPI),
    - port série avec le gestionnaire réseau (un ATMega*u* LUFA/RNDIS).

Version actuelle datée du 22 septembre 2024 à 10:04

Objectif

Voir le sujet dans le menu englobant. Vous aurez, comme d'habitude, la lourde tâche de tester ce module de travaux pratiques.

Réalisations des élèves

Numéro du binôme Numéro du groupe Elèves Page
Binôme 1 Groupe 1 Taha NEHARI & Martin CHAUVELIERE Binôme 1 2023/2024
Binôme 2 Groupe 1 Simon CRUCHET & Amaury BECQUET Binôme 2 2023/2024
Binôme 3 Groupe 1 Louis DERYCKERE & Romain DUHR Binôme 3 2023/2024
Binôme 4 Groupe 1 Thomas NAVE & Thibault DUYCK Binôme 4 2023/2024
Binôme 5 Groupe 2 Stéphane KADER ISSACK & Marion NORMAND Binôme 5 2023/2024
Binôme 6 Groupe 2 Dylan Ling Binôme 6 2023/2024
Binôme 7 Groupe 2 Louis WIJSMAN & Adrien PALIFERRO Binôme 7 2023/2024
Binôme 8 Groupe 2 Némo CAZIN & Antoine CEGARRA Binôme 8 2023/2024
Binôme 9 Groupe 3 Younes BENMBAREK & Youness EL QASTALANI Binôme 9 2023/2024
Binôme 10 Groupe 3 Heriniaina ANDRIANIRINTSOA & Chaymae RHANIM Binôme 10 2023/2024
Binôme 11 Groupe 3 Ayoub CHAOUNI & Bilal EL HASNAOUI Binôme 11 2023/2024
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