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Version actuelle datée du 27 janvier 2026 à 11:48

Premier bouclier conçu et routé. Commandé le 19/9, PCB fabriqué le 26/9, pas encore de PCBA.

30/10/2025 :
- Wiki : toujours pas grand chose
- schématique : ok
- PCB : une modification effectuée sur la zone quartz. Vous pouvez générer les fichiers de production

05/12/2025 :
- Wiki : il y a du mieux, éviter l'inutile et ajouter du texte explicatif
- PCB : uP fonctionnel, en attente de programmation
- ordonnanceur : dynamique avec intéractions
- carte réseau : pas commencé, vérifier si RNDIS tient sur le µP

05/01/2026
- Wiki : bien concernant la carte réseau, pratiquement rien d'ajouté sur les parties précédentes
- PCB : fonctionnel
- ordonnanceur : comme la dernière fois
- carte réseau : test du PC vers la carte réseau, Ethernet OK, IP OK, UDP pas de décodage du port !? Serveur sur le PC fonctionnel et testé.

@@ Ligne 5 : / Ligne 5 : @@
 ** schématique : ok
 ** PCB : ok
 * 30/10/2025 :
@@ Ligne 10 : / Ligne 11 : @@
 ** schématique : ok
 ** PCB : une modification effectuée sur la zone quartz. Vous pouvez générer les fichiers de production
+* 05/12/2025 :
+** Wiki : il y a du mieux, éviter l'inutile et ajouter du texte explicatif
+** PCB : uP fonctionnel, en attente de programmation
+** ordonnanceur : dynamique avec intéractions
+** carte réseau : pas commencé, vérifier si RNDIS tient sur le µP
+* 05/01/2026
+** Wiki : bien concernant la carte réseau, pratiquement rien d'ajouté sur les parties précédentes
+** PCB : fonctionnel
+** ordonnanceur : comme la dernière fois
+** carte réseau : test du PC vers la carte réseau, Ethernet OK, IP OK, UDP pas de décodage du port !? Serveur sur le PC fonctionnel et testé.
+* Note : 13.4/20
+** wiki : 50 % (e.g. vous n'avez pas utilisé la syntaxe Wiki comme expressément demandé)
+** PCB : 90 %
+** ordonnanceur : 100 %
+** code embarqué : 25 % (vous n'avez pas su déverminer une erreur qui ne semble pas bien complexe)
+** avancée / régularité : 70 %